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一个4位串行数据,输入4位移位寄存器,时钟脉冲频率为1kHz,经过()ms可以转

[单选题]一个4位串行数据,输入4位移位寄存器,时钟脉冲频率为1kHz,经过()ms可以转换为4位并行数据输出。A . 8B . 4C . 2D . 1

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  • 关于可编程逻辑阵列PLA,下列说法正确的是()。

    [单选题]关于可编程逻辑阵列PLA,下列说法正确的是()。A . PLA结构是与门阵列固定连接,而或门阵列可编程B . PLA结构是或门阵列固定连接,而与门阵列可编程C . PLA结构是与门阵列和或门阵列都可以编程D . PLA中,一个地址码对应的存储单元是唯一的

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  • 用555定时器构成的单稳态电路如图12-3所示。已知电源电压V=10V,R=33

    [单选题]用555定时器构成的单稳态电路如图12-3所示。已知电源电压V=10V,R=33kΩ,C=0.1μF,则输出电压的脉冲宽度为()mS。A . 10B . 3.3C . 1D . 3.63

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  • 如果把D触发器的输出Q反馈连接到输入D,则输出Q的脉冲波形的频率为CP脉冲频率f

    [单选题]如果把D触发器的输出Q反馈连接到输入D,则输出Q的脉冲波形的频率为CP脉冲频率f的()。A . 二倍频B . 不变C . 四分频D . 二分频

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  • A*B*B**C=()。

    [单选题]A*B*B**C=()。A . BB . CC . 1D . 0

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  • ()在计算机系统中得到了广泛的应用,其中一个重要用途是构成数据总线。

    [单选题]()在计算机系统中得到了广泛的应用,其中一个重要用途是构成数据总线。A . 三态门B . TTL与非门C . OC门

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  • 如图12-1所示,优先权编码器74148有8条输入线0~7,3条输出线A0~A2

    [单选题]如图12-1所示,优先权编码器74148有8条输入线0~7,3条输出线A0~A2。当GS为0时编码器输出有效,E1为0时允许模块工作。请问当输入线6为0,其余输入线为1时,则输出A2、A1、A0的状态分别为()。A . 0、1、0B . 0、0、1C . 1、1、0D . 1、0、1

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  • TTL与非门阈值电压UT的典型值是()

    [单选题]TTL与非门阈值电压UT的典型值是()A . 0.4VB . 1.4VC . 2VD . 2.4V

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  • 单稳态触发器中最重要的参数是()。

    [单选题]单稳态触发器中最重要的参数是()。A . 上触发电平B . 下触发电平C . 回差D . 暂稳宽度

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  • 小容量RAM内部存储矩阵的字数与外部地址线数n的关系一般为()

    [单选题]小容量RAM内部存储矩阵的字数与外部地址线数n的关系一般为()A . 2nB . 22nC . >22nD . <2

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  • TTL与非门输出低电平的参数规范值是()

    [单选题]TTL与非门输出低电平的参数规范值是()A . Uol≤0.3VB . Uol≥0.3VC . Uol≤0.4VD . Uol=0.8V

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  • 结构体(ARCHITECTURE)用于描述设计单元的()

    [多选题] 结构体(ARCHITECTURE)用于描述设计单元的()A . 行为、元件及连接关系B . 元件、子程序、公用数据类型C . 名称和端口的引脚等D . 可编译的设计单元

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  • 用原码输出的译码器实现多输出逻辑函数,需要增加若干个()。

    [单选题]用原码输出的译码器实现多输出逻辑函数,需要增加若干个()。A . 非门B . 与非门C . 或门D . 或非门

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  • TTL与非门输入短路电流IIS的参数规范值是()。

    [单选题]TTL与非门输入短路电流IIS的参数规范值是()。A . 20μAB . 40μAC . 1.6mAD . 16mA

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  • 要使JK触发器的输出Q从1就成0,它的输入信号JK就为()。

    [单选题]要使JK触发器的输出Q从1就成0,它的输入信号JK就为()。A . 00B . 01C . 10D . 无法确定

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  • 十进制数86转换为BCD码应为()。

    [单选题]十进制数86转换为BCD码应为()。A . 01010110B . 10000110C . 10011100D . 01101000

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  • 函数Y=ABC+A+ADE(F+G)的最简式为()。

    [单选题]函数Y=ABC+A+ADE(F+G)的最简式为()。A . ABCB . ADEC . ADEGD . A

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  • 晶体三极管工作在深饱和区时,IB、IC、β之间的关系为()。

    [单选题]晶体三极管工作在深饱和区时,IB、IC、β之间的关系为()。A . IC=βIBB . IC>βIBC . IC<βIBD . IC≥βIB

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  • 试提出数字频率计的三种设计方案,比较各种方案的特点。如果用HDPLD来实现,设计

    [问答题] 试提出数字频率计的三种设计方案,比较各种方案的特点。如果用HDPLD来实现,设计方案是最佳吗?简述理由。

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  • 下列逻辑代数基本运算关系式中不正确的是()。

    [单选题]下列逻辑代数基本运算关系式中不正确的是()。A . A+A=AB . A*A=AC . A+0=0D . A+1=1

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  • 利用2个74LS138和1个非门,可以扩展得到1个()线译码器。

    [单选题]利用2个74LS138和1个非门,可以扩展得到1个()线译码器。A . 2-4B . 3-8C . 4-16D . 无法确定

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  • 增加单稳态触发器的定时电阻R的值可以使输出脉冲的()。

    [单选题]增加单稳态触发器的定时电阻R的值可以使输出脉冲的()。A . 宽度增加B . 幅度减小C . 幅度增加D . 宽度减小

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  • 如果异步二进制计数器的触发器个数为10个,则计数状态有()种。

    [单选题]如果异步二进制计数器的触发器个数为10个,则计数状态有()种。A . 20B . 200C . 1000D . 1024

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  • 四位并行输入寄存器输入一个新的四位数据时需要()个CP时钟脉冲信号。

    [单选题]四位并行输入寄存器输入一个新的四位数据时需要()个CP时钟脉冲信号。A . 0B . 1C . 2D . 4

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  • 将一个最大幅值为5V的模拟信号转换为数字信号,要使模拟信号每变化10mV,数字信

    [单选题]将一个最大幅值为5V的模拟信号转换为数字信号,要使模拟信号每变化10mV,数字信号的最低位发生变化,应选用()位的A/D转换器。A . 6B . 7C . 8D . 9

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  • 对于负逻辑而言,某逻辑电路为与门,则对于正逻辑而言,该电路为()。

    [单选题]对于负逻辑而言,某逻辑电路为与门,则对于正逻辑而言,该电路为()。A . 与非门B . 与门C . 或非门D . 或门

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  • 以下代码中为无权码的为()。

    [单选题]以下代码中为无权码的为()。A . 8421BCD码B . 2421BCD码C . 余三码

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  • 两个与非门构成的基本RS触发器,当Q=1、Q=0时,两个输入信号R=1和S=1。

    [单选题]两个与非门构成的基本RS触发器,当Q=1、Q=0时,两个输入信号R=1和S=1。触发器的输出Q会()。A . 变为0B . 保持1不变C . 保持0不变D . 无法确定

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  • DRAM4164有2根片选线(RAS和CAS)、8根地址线和1根数据线。请判断它

    [问答题] DRAM4164有2根片选线(RAS和CAS)、8根地址线和1根数据线。请判断它的存储容量为多少?

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  • 五变量的卡诺图中共有最小项数为()个。

    [单选题]五变量的卡诺图中共有最小项数为()个。A . 10B . 16C . 64D . 32

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